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| "version": 1, |
| "model_ec": ["ODYSSEY_10"], |
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| "TLX_FIR": { |
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| "0": "0x08012000" |
| } |
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| } |
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| } |
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| "isolation_nodes": { |
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| { |
| "attn_type": ["RECOV"], |
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| "reg_name": "TLX_FIR_CFG_RECOV" |
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| { |
| "attn_type": ["SP_ATTN"], |
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| "reg_name": "TLX_FIR_CFG_SP_ATTN" |
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| { |
| "attn_type": ["UNIT_CS"], |
| "node_inst": [0], |
| "expr": { |
| "expr_type": "and", |
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| "expr_type": "reg", |
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| { |
| "expr_type": "reg", |
| "reg_name": "TLX_FIR_CFG_UNIT_CS" |
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| } |
| } |
| ], |
| "bits": { |
| "0": { |
| "desc": "Internal parity error" |
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| "1": { |
| "desc": "TLXT control register parity error" |
| }, |
| "2": { |
| "desc": "TLX VC0 return credit overflow" |
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| "3": { |
| "desc": "TLX VC3 return credit overflow" |
| }, |
| "4": { |
| "desc": "TLX DCP0 return credit overflow" |
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| "5": { |
| "desc": "TLX DCP3 return credit overflow" |
| }, |
| "6": { |
| "desc": "TLXC error" |
| }, |
| "7": { |
| "desc": "TLXC parity error" |
| }, |
| "8": { |
| "desc": "TLXT config parity error" |
| }, |
| "9": { |
| "desc": "TLXT response parity error" |
| }, |
| "10": { |
| "desc": "TLXT framer control parity error" |
| }, |
| "11": { |
| "desc": "TLXT Xarb control error" |
| }, |
| "12": { |
| "desc": "TLXT DLX interface error" |
| }, |
| "13": { |
| "desc": "TLX info register parity error" |
| }, |
| "14": { |
| "desc": "TLX reorder queue error" |
| }, |
| "15": { |
| "desc": "TLXT invalid configuration" |
| }, |
| "16": { |
| "desc": "TLXR is dropping commands after a fatal error" |
| }, |
| "17": { |
| "desc": "Malformed OC packet received" |
| }, |
| "18": { |
| "desc": "Protocol error detected in OC downstream sequence" |
| }, |
| "19": { |
| "desc": "Legal OC command not supported" |
| }, |
| "20": { |
| "desc": "Legal OC command length not supported" |
| }, |
| "21": { |
| "desc": "TLXR OC Misaligned" |
| }, |
| "22": { |
| "desc": "MMIO returned non-zero response to a write" |
| }, |
| "23": { |
| "desc": "Hardware error in TLXR control logic" |
| }, |
| "24": { |
| "desc": "TLXR Info Event" |
| }, |
| "25": { |
| "desc": "TLXR detected internal error" |
| }, |
| "26": { |
| "desc": "TLXR Threshold errors" |
| }, |
| "27": { |
| "desc": "Trace_Stop from TLXR" |
| } |
| }, |
| "capture_groups": [ |
| { |
| "group_name": "TLX_FIR", |
| "group_inst": { |
| "0": 0 |
| } |
| } |
| ] |
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| }, |
| "capture_groups": { |
| "TLX_FIR": [ |
| { |
| "reg_name": "SRQ_ROQ_CTL_0", |
| "reg_inst": { |
| "0": 0 |
| } |
| }, |
| { |
| "reg_name": "TLX_CFG_0", |
| "reg_inst": { |
| "0": 0 |
| } |
| }, |
| { |
| "reg_name": "TLX_CFG_1", |
| "reg_inst": { |
| "0": 0 |
| } |
| }, |
| { |
| "reg_name": "TLX_CFG_2", |
| "reg_inst": { |
| "0": 0 |
| } |
| }, |
| { |
| "reg_name": "TLX_CFG_3", |
| "reg_inst": { |
| "0": 0 |
| } |
| }, |
| { |
| "reg_name": "TLX_ERR_RPT_0", |
| "reg_inst": { |
| "0": 0 |
| } |
| }, |
| { |
| "reg_name": "TLX_ERR_RPT_1", |
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| "0": 0 |
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| }, |
| { |
| "reg_name": "TLX_ERR_RPT_2", |
| "reg_inst": { |
| "0": 0 |
| } |
| } |
| ] |
| } |
| } |